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LinkSwitch-XT的漏极与其他管脚的高压漏电要求是如何保证的

LinkSwitch-XT的漏极与其他管脚的高压漏电要求是如何保证的

LinkSwitch系列内部都是含有一个高压功率mosfet，其中漏极也是在开启及稳态工作时提供内部操作电流，以LinkSwitch-XT为例，是如何保证高压漏极与其它所有引脚之间满足高压漏电要求的？必须在PCB板上和封装上都要满足漏电要求才可以吧，对于最大漏极电压和最大漏极电流是否也和高压漏电要求有关？

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LV.9

2

2016-12-09 21:56

我发现无论哪种封装，它的漏极D都是隔离开的，也就是封装上比常规少一个管脚，这应该也是来保证漏电电压要求的么？

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LV.9

3

2016-12-14 21:34

依赖漏极节点电容来控制漏感引起的峰值漏极源极电压

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LV.9

4

2016-12-14 21:35

@fordfiash

依赖漏极节点电容来控制漏感引起的峰值漏极源极电压

最大输入电压、漏感能量以及初级绕组电容决定了峰值漏极电压

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LV.10

5

2016-12-15 17:01

@gdhe342

[图片][图片]我发现无论哪种封装，它的漏极D都是隔离开的，也就是封装上比常规少一个管脚，这应该也是来保证漏电电压要求的么？

没错，这个应该是防止管脚间距以及短路的发生，刻意封装时候留了一个空位脚

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LV.9

6

2016-12-16 14:42

@opingss88

没错，这个应该是防止管脚间距以及短路的发生，刻意封装时候留了一个空位脚

短路我觉得一般到不会，就是距离短了怕有漏电和回路，返到漏级就麻烦大了

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LV.9

7

2016-12-16 22:43

漏电要求是芯片本身的制造工艺决定的，只要按照规定的pcb布局要求设计就ok

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LV.9

8

2016-12-16 22:45

@gdhe342

短路我觉得一般到不会，就是距离短了怕有漏电和回路，返到漏级就麻烦大了

貌似这种封装在LinkSwitch的其他系列里面也是这样的，看来对于D级隔离还是需要的

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LV.4

9

2016-12-17 23:11

@gdhe342

[图片][图片]我发现无论哪种封装，它的漏极D都是隔离开的，也就是封装上比常规少一个管脚，这应该也是来保证漏电电压要求的么？

漏极的布线感觉比较细，是因为需要保证安全距离的原因么

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LV.4

10

2016-12-17 23:12

@erecing

貌似这种封装在LinkSwitch的其他系列里面也是这样的，看来对于D级隔离还是需要的

这种缺脚封装只在电源类的芯片上看到过，pi的好多系列都是这样

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LV.9

11

2016-12-18 15:53

最大漏极电压是用来校验在最高输入电压和峰值输出功率时VDS没有超过mosfet耐压值

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LV.9

12

2016-12-18 15:54

@truim333

最大漏极电压是用来校验在最高输入电压和峰值输出功率时VDS没有超过mosfet耐压值

最大漏极电流是检测电源开启时是否出现过高的前沿导通电流尖

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LV.6

13

2017-01-05 13:57

PI的电源芯片都是小功率输出的，LinkSwitch系列也是小功率LED上面用的比较多。

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LV.8

14

2017-01-11 08:55

本来是8脚的贴片间距比较小，为了加大D和S脚之间漏电距离还特地少放一个引脚。

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