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请问关于to246的测试

将连在c脚上的电压增大的时候,输出的占空比也随之增大,而且可以达到100%,可是按照datasheet上的说明占空比应该是随电流增大而减小,而且最高只能到78%.
而且不论v1和v2哪个先上开始DS两端都没有波形,只有上电后将C,S短路波形才能出来.
请问是什么原因阿?
如图:500) {this.resized=true; this.width=500; this.alt='这是一张缩略图,点击可放大。\n按住CTRL,滚动鼠标滚轮可自由缩放';this.style.cursor='hand'}" onclick="if(!this.resized) {return true;} else {window.open('http://u.dianyuan.com/bbs/u/55/1438741184654205.jpg?x-oss-process=image/watermark,g_center,image_YXJ0aWNsZS9wdWJsaWMvd2F0ZXJtYXJrLnBuZz94LW9zcy1wcm9jZXNzPWltYWdlL3Jlc2l6ZSxQXzQwCg,t_20');}" onmousewheel="return imgzoom(this);">
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2007-07-17 14:54
top是通过检测流进C脚的电流来调整输出的.输出的最大占空比是78%,你的调试电路有问题.一是电容要接在C脚上,另R7的电阻太小.加大到1.5K
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warlock
LV.2
3
2007-07-17 17:27
@powerint_tny
top是通过检测流进C脚的电流来调整输出的.输出的最大占空比是78%,你的调试电路有问题.一是电容要接在C脚上,另R7的电阻太小.加大到1.5K
都改过来了,D还是随V2增加而增加
V2从7.2v到14v调节时,D从25%到100%增加,当V2小于7.2v,D跳变为0输出关断,而且无法重启,即使再将V2调高,D依然为0;当V2大于14V,D到100%后,电压往下调,D也可以随之变小.
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2007-07-18 09:34
@warlock
都改过来了,D还是随V2增加而增加V2从7.2v到14v调节时,D从25%到100%增加,当V2小于7.2v,D跳变为0输出关断,而且无法重启,即使再将V2调高,D依然为0;当V2大于14V,D到100%后,电压往下调,D也可以随之变小.
你的图画错了,C3和C4
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2007-07-18 09:38
@powerint_emi
你的图画错了,C3和C4
请参考下面的图
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2007-07-18 09:39
@powerint_emi
请参考下面的图
500) {this.resized=true; this.width=500; this.alt='这是一张缩略图,点击可放大。\n按住CTRL,滚动鼠标滚轮可自由缩放';this.style.cursor='hand'}" onclick="if(!this.resized) {return true;} else {window.open('http://u.dianyuan.com/bbs/u/55/949531184722761.jpg');}" onmousewheel="return imgzoom(this);">
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warlock
LV.2
7
2007-07-18 15:19
@powerint_emi
请参考下面的图
改过来了,还是这样
为什么当V1增加的时候占空比也会增加呢?
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2007-07-19 14:31
@warlock
改过来了,还是这样为什么当V1增加的时候占空比也会增加呢?
我的看法:你是不是把占空比搞反了
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warlock
LV.2
9
2007-07-23 13:56
@powerint_emi
我的看法:你是不是把占空比搞反了
确实
理解错了=,=
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