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请教：关于TL431与PC817在正激电路中的环路设计

请教：关于TL431与PC817在正激电路中的环路设计

各位老师，大家好，我在调试一个用3844控制的双管正激电路，输入直流整流电压320V，高频变压器是24:8,设计目标是24V/10A输出，在反馈环路设计上遇到了些问题：无论怎么调节我图中的R15，3844的6脚输出PWM的占空比都非常小，请问我环路设计哪些地方要修改才能提高占空比最终提高输出电压呢？随着我R15的调节，3844的1脚电压从2.4V升高到2.9V，输出电压从15V升到18V此后再也升不上去了。如何让3844的1脚电压升上去呢？

还有：TL431的RA电压是1.5V而不是2.5V这又是为何呢？

恳请大家帮忙指导，比较急，谢谢各位老师！

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LV.2

2

2011-03-22 11:31

恳请大家指导，不胜感激！现在有点急了

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让你记得我的好

LV.10

3

2011-03-22 11:38

你的原理图有严重错误。

Q2的S极怎么接？没有通过电流采样电阻接地？

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LV.2

4

2011-03-22 12:35

@让你记得我的好

你的原理图有严重错误。Q2的S极怎么接？没有通过电流采样电阻接地？

画错了，但接的时候是接采样电阻的，如下图。

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LV.2

5

2011-03-22 15:14

@sbcceeq

画错了，但接的时候是接采样电阻的，如下图。[图片]

以上为输出22V不是24V，调节R15不起作用。环路到底哪出了问题

上图CH1为3844的3脚Isense波形，CH2为6脚PWM波形，它的正脉宽太窄，如何让环路提高占空比呢？

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让你记得我的好

LV.10

6

2011-03-22 18:13

@sbcceeq

[图片] 以上为输出22V不是24V，调节R15不起作用。环路到底哪出了问题[图片] 上图CH1为3844的3脚Isense波形，CH2为6脚PWM波形，它的正脉宽太窄，如何让环路提高占空比呢？

在3844的3脚和5脚之间并一只470pF的高频瓷片电容看看。

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LV.11

7

2011-03-22 18:37

@让你记得我的好

在3844的3脚和5脚之间并一只470pF的高频瓷片电容看看。

也可以在3脚到地接一个104的电容。

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LV.2

8

2011-03-23 05:25

@让你记得我的好

在3844的3脚和5脚之间并一只470pF的高频瓷片电容看看。

我试了，从330到470PF效果都不理想，图形见下

CH1为6脚输出PWM，CH2为3脚波形

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LV.8

9

2011-03-23 05:53

1脚10K到地，2脚10K到地，1~2脚之间5.1K，3脚102瓷片到地就可以了。

R6太小了吧？频率有点高哦！

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让你记得我的好

LV.10

10

2011-03-23 08:29

@sbcceeq

我试了，从330到470PF效果都不理想，图形见下 [图片] CH1为6脚输出PWM，CH2为3脚波形

那就把电容继续放大。你现在的问题是3脚开通瞬间的尖峰信号超过的过流保护阀值，所以占空比打不开。

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LV.5

11

2011-03-23 13:26

初級多少圈？

初級繞45TS左右．

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LV.2

12

2011-03-24 01:26

@mujian123

初級多少圈？初級繞45TS左右．

　谢谢，初级24圈，暂时改不了变压器的参数，材料不全。

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LV.5

13

2011-03-25 09:11

@sbcceeq

　谢谢，初级24圈，暂时改不了变压器的参数，材料不全。

初級太少了,你用多大規格的變壓器?

變壓器材料不是到處都有,廠商也可以送樣的.

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LV.2

14

2011-03-25 11:53

@mujian123

初級太少了,你用多大規格的變壓器?變壓器材料不是到處都有,廠商也可以送樣的.

EE40的磁芯，PC40材质，都用直径0.45的漆包线绕，初级24匝，次级24V输出用的是8匝

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LV.5

15

2011-03-25 16:14

@sbcceeq

EE40的磁芯，PC40材质，都用直径0.45的漆包线绕，初级24匝，次级24V输出用的是8匝

加圈數吧,EE-40很大的,0.45的兩根,初級45TS是可以繞的,次級可以加到12TS的樣子,(立臥式一樣)三明治繞線,加屏蔽,加VCC就OK了.

電路應還有其它問題的.

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LV.9

16

2011-03-27 02:42

@mujian123

加圈數吧,EE-40很大的,0.45的兩根,初級45TS是可以繞的,次級可以加到12TS的樣子,(立臥式一樣)三明治繞線,加屏蔽,加VCC就OK了.電路應還有其它問題的.

没看出TL431回路有问题啊

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