静电不能被消除，只能被控制。
控制ESD的基本方法：
堵；
从机构上做好静电的防护，用绝缘的材料把PCB板密封在外壳内，不论有多少静电都不能到释放到PCB上。
导；
有了ESD，迅速让静电导到PCB板的主GND上，可以消除一定能力的静电。
对于非金属外壳或有金属背板的产品我来分析一下ESD问题；
重点分析非金属外壳的内部电路及PCB的ESD的设计；
参考如下结构：（注意有的产品内部由金属背板）
针对这些穿过电路板PCB的干扰：
（电场耦合和磁场耦合都存在系统无接地！）
一方面我们要规划干扰在PCB上的路径（注意这是在电路板-PCB布局布线是需要提前规划的）；另一方面要尽量控制干扰的幅度。
注意有些产品外壳是非金属结构；但系统内部为了产品的强度或者是为了应对EMC设计的需求会有金属背板的设计！我们还要注意以下ESD路径；
进行分析：干扰电流为何会穿越PCB？
一定是PCB电路板一边的接口及连接线，输入I/O接口及连接线引入了干扰，或者如上述看到产品的结构搭接&孔缝！干扰从内部电路，功能单元，系统走线流向大地！（系统参考接地板）如上面的两图示路径！
绝大多数情况下，PCB电路板多边有接口及连接线是常见情况；接口及连接线多，就会有测试整改难度的提高，无论系统有多复杂我们还是有对策的！
首先逐一插拔接口及连接线，看看拔掉哪个接口或连接线可以提高抗扰度。如果可以找得到影响抗扰度的连接线或接口，我们可以直接跨接电容，把干扰旁路掉。
这也是一种措施；在电路设计时我是推荐应用的！
在对应导线上套磁环可以减小干扰电流，也是措施之一。（我常用这种方法来指导客户进行问题的判断和分析！）
如果插拔接口或连接线没有明确的发现，就要规划干扰路径也就避免或者减少流经敏感电路的干扰电流，例如避免干扰电流流经CPU/MCU&控制电路及晶振（振荡器布局布线！）电路等；如上图所示！
对于CPU/MCU，尽量使引脚处于高阻状态，阻止干扰电流流入！
CPU/MCU的输出引脚，要串电阻并旁路电容，切不可引脚直通外部电路！
即便没有干扰信号，引脚直通也是不合理的，易引起CPU/MCU的故障损坏！
ESD引起的复位分析！
注意，看门狗复位也会导致软件重启机复位！
硬件复位主要是两个源头:
A.电源电压过低，CPU内部电路产生了一个复位信号；
B.复位引脚上有一个复位脉冲信号注入。
1．CPU/MCU电源线布线合理，退耦电容适当布置，依靠ESD耦合过来的这点能量拉动电源到复位电平的可能性比较小，不作优先考虑。
2．复位引脚有干扰的情况比较多出现，优先考虑。
注意点:
a)复位电路引线是否过长；
b)复位电路是否形成大圈；
c)芯片复位引脚是否接一个小电容到就近地；
d)复位信号有没有供其他芯片使用；
e)有没有用专用复位芯片。
布局得当就不太容易产生硬复位，相对与重启机还是比较容易处理的。
如果是a、b问题，则在辐射抗扰度测试时也会产生复位。
基本措施：
靠近CPU复位引脚切断复位信号线串1~10KΩ电阻，复位引脚对地就近并1~10nF电容。相对来说，直接硬复位干扰还是比较容易处理的。
软件方面：
需要确定的系统MCU/CPU-I/0口或控制信号受干扰引起误动作的情况。
由于ESD是瞬态干扰，持续时间非常短，重复读取控制信号状态基本上就可以排除干扰。注意增加的滤波电路也有可能起反作用的；例外情况：磁珠与电容组合会展宽干扰电平，需要增加信号确认时间，对于需要快速响应的程序就要好好考虑一下！
A.确定的某个模拟量信号受干扰引起误动作的情况;先用硬件的方法进判断。
由于ESD是瞬态干扰，数字滤波程序运用排除最大最小值的办法就可以排除干扰。
同样，滤波电路会展宽干扰信号，造成连续采到几个干扰信号，不能全部排除。
B.干扰引起硬复位的情况。主要有两种情况会让CPU/MCU复位，一个是复位引脚受干扰，另一个是电压下降使上电判断电路产生复位信号。
这些相对比较容易处理，增加电阻电容滤波、合理布线基本上可以解决问题。
C.比较难处理的是死机或者死机引起的看门狗复位。
可能是任何引脚引入干扰的干扰，需要逐一排除，由于很少是单一引脚引入干扰，处理起来比较麻烦，如果结构上或者外围电路上没有有效措施，电路板PCB布局布线重新做的可能性较大。PCB的关键问题点：过大的环路面积造成问题！！
D.软件敏感性，引脚阻抗Flash芯片写操作；ESD脉冲短，脉冲串也不长，未必与软件敏感状态重叠，所以测试验证时要充分考虑这些情况。硬件设计可以提高干扰强度，一定要注意软件敏感环节。
电路板PCB干扰机理分析
1.金属构件是否会产生交大dv/dt，并耦合到临近的敏感电路；
2.检验放电通路是否由于寄生电感因di/dt产生感性耦合到敏感电路；
3.ESD通常是同时存在dv/dt及di/dt，一般dv/dt更容易产生耦合；
4.共模电流预规划措施不佳，让较多共模干扰电流流经敏感电路；
5.敏感电路对地有较低共模阻抗，使较大共模干扰电流经由敏感电路流向地。
流经敏感电路的共模干扰电流不会消失，它同样还要流回地，任何从敏感电路引出的导线都有可能是流经敏感电路的干扰电流流回地的途径；
6.共模干扰电流在敏感电路产生差模才会引起干扰，敏感电路有较大的阻抗不平衡，使流经的共模干扰电流产生了差模电压；
7.受干扰器件引脚阻抗过高；
8.器件受扰动作阈值过低；
9.振荡器电路工作异常；软件没有能够分离处理好瞬态干扰信号（或者是软件算法有问题）；
对于系统为非金属外壳的电子产品或者设备；静电ESD对产品的裸露的金属部分进行接触放电同时对结构的缝隙进行非常高电压的（>16KV）的空间放电时；系统内部就会是电场耦合和磁场耦合都存在复杂环境；走线环路面积是关键！！
我们要重点关注关键信号线的走线及环路面积的问题；如下图说明：
PCB与外部产生电磁耦合
磁场： u0= 4Л*10^-7 感应电压计算：磁场 & 电场
V=S× u0 ×ΔH/Δt
H=I/（2 × Л ×D ）
电场：
V=S× E × FMHZ /48电场下的频率
我来进行一下实际的数据计算分析：如下图
A.电场问题！参数实例说明
è环路面积=20cm^2 测试场电压为30V/m@150MHZ, 估算感应电压？
V=0.0020*30*150/48
V=200mV
B.磁场问题！ESD-静电放电的场影响
è环路面积=2cm^2 离ESD测试电流（30A）的距离=50cm , Δt=1ns
H=I/（2 ×Л ×D ）估算感应电压？
Δt=1ns , H=I/（2×Л×D） =30/（2* Л *0.5）=10A/m
V=0.0002*4*Л*10^-7 * 10/(1*10^-9)
V=2.5V!
结论：
无接地系统对应强干扰环境PCB的布局布线的环路面积是设计的关键！！